Category Archives: IC 設計

一次買進台積電、聯發科僅 1.5 萬,中信小資高價 30 ETF 7/27 募集

作者 |發布日期 2021 年 07 月 21 日 17:00 | 分類 IC 設計 , 晶片 , 會員專區

台股盤中零股交易自 2020 年 10 月上路後,明顯帶動零股交易量,目前零股交易量約為政策上路前的 3~6 倍,同期間台股指數持續上攻,截至今日收盤已有 9 檔千金股,導致小資族的投資意願日益增長,卻面臨台股越來越貴的困境,因此中信投信特別推出中信小資高價 30 ETF,讓小資族可以一口氣買進台積電、聯發科、大立光等高價股。

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安格科技擬 8 月中上櫃,7/22 啟動競拍底價 76.52 元

作者 |發布日期 2021 年 07 月 20 日 16:20 | 分類 IC 設計 , 晶片 , 會員專區

多元視訊轉換解決方案晶片開發商安格科技今日宣布,配合上櫃前公開承銷作業,辦理現金增資發行新股 2,920 張,其中 1,986 張採競價拍賣,競價拍賣期間為 7 月 22 至 26 日,競拍底價為 76.52 元;預計於 7 月 28 日上午 10 點開標,並於 7 月 30 日至 8 月 3 日辦理公開申購。

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IME 發表 4 層半導體層 3D 堆疊技術,可提升效能降低成本

作者 |發布日期 2021 年 07 月 20 日 16:10 | 分類 IC 設計 , 封裝測試 , 晶片

半導體製程技術研發愈困難,想精進更先進製程已相當不容易。除了製程微縮這條路,要持續提升半導體晶片效能,3D 堆疊技術也為另一種選擇。外媒《TomsHardware》報導,微電子研究所 (Institute of Microeletronics,IME)研究人員表示達成技術突破,透過多達 4 個半導體層堆疊,提升半導體晶片效能。這技術與傳統的 2D 製造技術相較,不但可節省 50% 成本,還可用於未來及平台整合設計,如 CPU 和 GPU 甚至是記憶體整合,實現新一代 3D 晶片堆疊發展。

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傳華為海思 OLED 驅動 IC 將於 2022 年上市,恐攪亂業界一池春水

作者 |發布日期 2021 年 07 月 19 日 12:00 | 分類 IC 設計 , 中國觀察 , 晶片

中國媒體報導,華為海思首款 OLED 驅動 IC 採用 40 奈米製程生產,預計 2022 上半年量產,月產能 200~300 片晶圓,樣品送給京東方、華為、榮耀等廠商測試中。如果華為海思 OLED 驅動 IC 成功量產,市場預期恐影響南韓及台灣相關 IC 廠商。

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外資:中國微控制器自主化比例提升,新唐將受惠定目標價 155 元

作者 |發布日期 2021 年 07 月 19 日 11:30 | 分類 IC 設計 , 中國觀察 , 晶片

受惠於中國半導體自主化,微控制器(MCU)廠商快速發展。美系外資預期,中國 MCU 整體市場規模約 50 億美元,廠商自主化持續發展,中國廠商將從目前市佔率 3 億美元,成長到 2025 年 20 億美元,是目前 6 倍多,轉化到全球市場,將由 2020 年市佔率 2%~3% 成長至 2025 年 10%。華邦集團旗下微處理廠商新唐也將受惠,給予「買進」投資評等,將目標價訂為每股 155 元。

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松翰董座陳賢哲交棒!董事會推選鮑世嘉接任、柯福順擔任總經理

作者 |發布日期 2021 年 07 月 16 日 14:46 | 分類 IC 設計 , 公司治理 , 會員專區

微控制器(MCU)廠松翰今(16)日召開股東會,會後隨即召開董事會,一致推選鮑世嘉擔任董事長一職,並任命業務副總柯福順擔任總經理職務,原董事長陳賢哲交棒,但仍任公司董事,持續協助松翰發展,人事案即日起生效。

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安格科技 8 月中旬掛牌上櫃!Type C 轉換帶動上半年營收翻倍

作者 |發布日期 2021 年 07 月 14 日 17:46 | 分類 IC 設計 , 公司治理 , 會員專區

視訊轉換晶片設計業者安格科技明(15)日將舉辦上櫃前業績發表會,總經理藍世旻表示,受惠遠距需求帶動,電腦周邊轉換晶片銷售暢旺,再加 USB Type C 產品及影像轉換需求提升,帶動上半年營收翻倍,並對未來營運前景相當樂觀,預計將在 8 月中旬掛牌上櫃。

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聯電攜手 Cadence 開發 22ULP 與 ULL 製程認證,搶攻消費、5G 和汽車應用設計市場

作者 |發布日期 2021 年 07 月 14 日 7:50 | 分類 IC 設計 , 晶圓 , 晶片

晶圓代工大廠聯電宣布與益華電腦 (Cadence) 優化的數位全流程,已獲得聯華電子 22 奈米超低功耗 (ULP) 與 22 奈米超低漏電 (ULL) 製程技術認證,以加速消費、5G 和汽車應用設計。聯電指出,該流程結合了用於超低功耗設計的領先設計實現和簽核技術,協助共同客戶完成高品質的設計並實現更快的晶片設計定案 (tape out) 流程。

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